Quadcept : Quadceptとは
制限について
Quadceptの各制限値についてご紹介します。
| 項目 | 制限値 |
|
基板サイズ |
1500mm×2000mm |
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層数 |
物理層255層まで（カスタム層の種類は無制限） |
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桁数 |
有効桁数 整数9桁、小数9桁 |
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禁止文字 |
なし（但し、出力するネットリストの種類やフォーマットによっては、適さない文字があります。） |
アカウント管理/ライセンス管理
- Quadcept Account (アカウント/ユーザー管理システム）について
- Quadcept Manager （ライセンス管理システム）について
- Quadcept Account / Quadcept Manager への切り替え方法
- ユーザー登録方法
- ログイン/ログアウト
- クレジットカード追加
- クレジットカードの設定
- セキュリティ設定
- ブラウザの「シークレットモード」でログインする方法
- Cookie（クッキー）の削除方法
- チーム情報の登録/管理
- ユーザー情報の登録/管理
- ライセンス情報の登録/管理
- 各種サポート
- 製品ダウンロード
- Digi-Key連携の有効化
- Quadceptの退会
Quadcept
- はじめに
- はじめにお読みください
- Quadcpetの基本について
- 画面構成
- 設計/編集の基本操作
- メニューの実行
- Quadceptアプリケーションの終了
- プロジェクトについて
- プロジェクトの機能
- プロジェクト設定
- ライブラリキャッシュについて
- 部品について
- 部品の作成方法
- シンボルの作成方法
- フットプリント作成方法
- IPCフットプリント作成
- Spice部品
- spiceピンオーダー
- デバイスタイプ
- 抵抗 R-Resistors
- コンデンサ C-Capacitors
- コイル L-Inductors
- ダイオード D-Junction Diodes
- トランジスタ J-Junction Field-Effect Transistors
- トランジスタ Q-Bipolar Junction Transistors
- MOSFET M-MOSFETS
- MESFET Z-MESFETS
- サブサーキット Sub Circuit
- 電圧スイッチ S-Voltage Controlled Switch
- 電流スイッチ W-Current Controlled Switch
- 半導体抵抗 Rs-Semicondutor Resistors
- 半導体コンデンサ Cs-Semicondutor Capacitors
- 半導体コイル Ls-Semicondutor Inductors
- 電圧制御線形電流源 G-VCCS
- 電圧制御線形電圧源 E-VCVS
- 電流制御線形電流源 F-CCCS
- 電流制御線形電圧源 H-CCVS
- デジタル AND A-Digital And
- デジタル OR A-Digital Or
- デジタル Buffer A-Digital Buffer
- デジタル Inverter A-Digital Inverter
- デジタル XOR A-Digital Xor
- デジタル Buffer A-Digital Buffer1
- デジタル COUNTER A-Digital COUNTER
- デジタル D Flip Flop A-Digital D Flip Flop
- デジタル SR Flip Flop A-Digital SR Flip Flop
- デジタル PHASEDET A-Digital PHASEDET
- デジタル SCHMTBUF A-Digital SCHMTBUF
- デジタル SCHMTINV A-Digital SCHMTINV
- デジタル SCHMITT A-Digital SCHMITT
- デジタル DIFFSCHMBUF A-Digital SCHMTDIFFBUF
- デジタル DIFFSCHMTINV A-Digital SCHMTDIFFINV
- デジタル DIFFSCHMITT A-Digital SCHMITT
- LTspice電源部品の作成方法
- LTspice電源部品の電圧・電流や波形の設定
- 電圧源-直流信号
- 電流源-PWL波
- 電流源-FM波
- 電流源-ノコギリ波
- 電流源-パルス波
- 電流源-正弦波
- 電流源-直流信号
- 電圧源-PWL波
- 電圧源-FM波
- 電圧源-ノコギリ波
- 電圧源-パルス波
- 電圧源-正弦波
- 電流源-TABLE
- share（部品共有ライブラリ）
- Ultra Librarian連携
- SamacSys
- 部品連携
- 設計変更転送/新旧データ差分比較
- 全体メニュー
- ファイル操作
- Quadceptファイル入出力
- PCBデータコンバート
- メニューカスタマイズ
- スタートページ
- アップデート
- リリースノート
- バージョン情報
- システム情報
- 便利機能
回路図エディタ
- 回路図設計の流れと構成
- 回路図を作成する
- 回路図作成について
- 部品を配置する
- Referenceを更新する
- 回路図検証（ERC/DRC）
- 各種出力(部品表、ネットリストなど）
- 回路図設定
- ピン/電源/ポートを作成する
- 電源の作成
- ポートの作成
- 図面枠を作成する
- 作図・編集
- 原点
- LTspiceと連携
- GND設定
- 解析の種類
- Transient(時間軸解析)
- ACAnalysis(周波数軸解析)
- DC Sweep(部品特性解析)
- Noise(ノイズ解析)
- DC Transfer(小信号伝達関数解析)
- DC op pnt(動作点解析)
- オプション
- SPICE属性表示
- 各種便利機能
- 各種便利機能
- 移動・回転・反転
- 表示オプション
プリント基板CAD
- プリント基板設計の流れと構成
- プリント基板設計を行う
- プリント基板設計について
- ネット操作
- 部品を配置する
- 配線作業
- Referenceを更新する
- 仕上げ作業
- PCB検証（DRC/MRC）
- DRCエラー詳細
- DRCエラー：未配線ネット
- DRCエラー：クリアランス
- DRCエラー：部品クリアランス
- DRCエラー：ビア規則
- DRCエラー：配線幅
- DRCエラー：配線長/等長配線
- DRCエラー：差動ペア
- DRCエラー：円弧配線
- DRCエラー：ダングリング
- DRCエラー：浮きビア/スタブビア/ドリル重複
- DRCエラー：スタックビア
- DRCエラー：配線角度
- DRCエラー：ティアドロップ
- DRCエラー：パッドオンビア
- DRCエラー：ベタ分断
- DRCエラー：多角形/ベタねじれ
- DRCエラー：浮きベタ
- DRCエラー：禁止領域
- DRCエラー：サーマル
- DRCエラー：テストランド
- DRCエラー：設計指示
- DRCエラー：部品編集確認
- DRCエラー：アノテーション
- DRCエラー：浮きパターン
- 逆ネットリスト
- パネライズ（面付け）
- 各種出力（CAM、ドリル、部品座標など）
- 設計変更転送/新旧データ差分比較
- PCB設定
- PCB設定
- ガーバーを確認する
- 自動配線ツール連携
- 作図・編集
- 原点
- 各種便利機能
- 各種便利機能
- テストランド自動作成
- 角形状変更
- ジャンパー交換
- カスタマイズパッド：パッド合成
- カスタマイズパッド：パッドカット
- スワップ
- 相対移動
- 回転移動
- 層間移動
- 検索（PCB）
- 部品寸法線自動作成
- 基板外形寸法線自動作成
- オンラインDRC
- デザインルール領域
- 内層についての便利機能
- 層変更
- テストランド交換
- 原点を中心へ
- ビア交換
- ガーバー/NCドリル入力
- DXF/DWG入力
- DXF/DWG出力
- DSN出力
- 塗りオブジェクトに変換
- ラインに変換
- フィルタ
- 配線の整列
- 角処理
- 配線長情報表示
- 部品属性情報表示
- 整列
- 図形分割
- 禁止領域自動作成
- ものさし
- 線スタイル変更
- 円の中心にビアを配置
- PollEx ASCII出力
- 基板情報表示
- オブジェクト情報表示
- 部品属性一覧
- 線分の輪郭をベタに変換
- 線分の輪郭を塗り図形に変換
- 配線長（セグメント）の変更
- 作業層の優先
- 型抜き（シルクカット）
- 部品内編集を有効
- 座標入力
- オフセット図形作成
- 属性文字の作成（同一属性文字の複数配置）
- ビアの連結
- RTE/SES入力
- 配線に変換
- 部品配置情報の出力/入力
- コイル配線作成
- 自動シルクカット（一括シルクカット）
- リビジョン情報表示
- 繋がり確認/補正
- 一括角処理
- イメージ比較
- 選択方法
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NET CHANGER
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- P-CAD (WRL)
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- SCICARDS
- TANGO
- Telesis
- VISULA
- WorkView(Net)
- WireList
- Xpedition PCB
